本书聚焦CMOS模拟集成电路版图设计领域，从版图的基本概念、设计方法和EDA工具入手，循序渐进介绍了CMOS模拟集成电路版图规划、布局、设计到流片的全流程；详尽地介绍了目前主流使用的模拟集成电路版图设计和验证工具——Cadence IC 6.1.7与Siemens EDA Calibre Design Solutions（Calibre）；同时展示了运算放大器、带隙基准源、低压差线性稳压器、模-数转换器等典型模拟集成电路版图的设计实例，并结合实例对LVS验证中的典型案例进行了归纳和总结；最后对集成电路设计使用的工艺设计工具包内容，以及参数化单元建立方法进行了讨论。

本书通过结合基础、工具和设计实践，由浅入深，使读者深刻了解CMOS模拟集成电路版图设计和验证的规则、流程和基本方法，对于进行CMOS模拟集成电路学习的高年级本科生、研究生，以及从事集成电路版图设计与验证的工程师，都能提供有益的帮助。

图书在版编目（CIP）数据

芯片设计：CMOS模拟集成电路版图设计与验证：基于Cadence IC 6.1.7/陈铖颖等编著.—2版.—北京：机械工业出版社，2023.12

（半导体与集成电路关键技术丛书.微电子与集成电路先进技术丛书）

ISBN 978-7-111-73780-3

Ⅰ.①芯… Ⅱ.①陈… Ⅲ.①芯片－设计 Ⅳ.①TN402

中国国家版本馆CIP数据核字（2023）第165824号

机械工业出版社（北京市百万庄大街22号 邮政编码100037）

策划编辑：江婧婧　　　　　责任编辑：江婧婧

责任校对：郑　婕　张　征　封面设计：鞠杨

责任印制：常天培

北京机工印刷厂有限公司印刷

2023年12月第2版第1次印刷

169mm×239mm·31印张·601千字

标准书号：ISBN 978-7-111-73780-3

定价：149.00元

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